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Encounter
纳米低功耗IC设计技术研讨会
2006年2月28日---北京
邀请信
尊敬的
先生/女士，
能源是全球的热点问题；节能经济是中国“十一五”规划的目标之一。全球领先的低功耗电子设计技术供应商Cadence公司和北京集成电路设计园诚邀您参加第二代Encounter低功耗IC设计技术研讨会。本次研讨会由Cadence公司和北京集成电路设计园双方联合举办并邀请到Cadence多位资深IC设计专家作主题演讲，介绍Cadence公司在纳米低功耗IC设计方面的领先解决方案，为您带来最前沿的低功耗设计技术信息。同时，您还将有机会与现场来宾进行交流。
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会议概要：
在90纳米以下的设计中，您将怎样应对功耗控制的新挑战？通过本技术讲座，您可以了解到如何控制动态及漏电流功耗.
并看到Cadence
Encounter
低功耗设计流程是如何减少功耗的。
技术亮点：
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Encounter
RTL Compiler
电源优化全局综合技术
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Encounter
platform:
多电源设计实现流程
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Encounter
platform:
多电源设计的优化及分析
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Encounter
Conformal:形式验证
面向对象：寻求纳米级IC低功耗设计解决方案的设计及管理人员
会议时间：2006年2月28日星期二
（9:30-17:00）
会议地点：北京金域万豪酒店，
二层万豪殿1厅
（海淀区西三环北路98号，航天桥东北角）
会议日程：
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Time |
Items |
presenter |
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9:30-10:00 |
Registration & morning break
签到及早点 |
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10:00-10:05 |
Welcome speech
致欢迎词 |
John Peng
Cadence中国区市场部经理 |
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10:05-11:00 |
Low Power Overview
低功耗设计概述 |
Yingchun Wang |
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11:00-12:00 |
Encounter update and low power implementation
数字IC设计平台最新进展及低功耗IC设计实现 |
Yingchun Wang |
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12:00-13:00 |
Lunch---午餐
（酒店5层中餐厅） |
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13:00-14:30 |
Low power flow Technical presentation: Implementation
低功耗流程的技术实现 |
Chao Lu |
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14:30-15:30 |
Low Power Verification
面向低功耗设计的验证技术 |
Zhenshan Wang |
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15:30-15:45 |
Break---茶歇 |
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15:45-16:30 |
Silicon Design Chain on Low Power Phase II
第二代低功耗设计技术与硅设计链 |
John Peng |
Encounter
低功耗设计流程研讨会（北京）
 回执
免费参加、座位有限，为保证研讨会效果，如您确定参加此次会议，
请您即刻点击这里
报名
!
，或登陆网站在线报名
www.cadence.com
也可以发e-mail或传真给我们，谢谢您的合作！报名截止日期：2006年2月24日
email:
imby@cadence.com
；
Fax To: 010-62509241
垂询电话：10
– 82872200-3026 班小姐
以下内容请用正楷填写：（注：一个部门最多有3个参会名额）
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